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Cedric FAU

Colombelles

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En résumé

Après plusieurs années dans le domaine de la téléphonie mobile et le numérique, je m'investis désormais dans l'automobile et le mixed signal.

Mes compétences :
Digital
ARM
Design

Entreprises

  • NXP Semiconductors - Ingénieur Vérification Mixed Signal (SV-UVM,VAMS,Python)

    Colombelles 2015 - maintenant

  • FREESCALE - Ingénieur Vérification Mixed Signal (SV-UVM,VAMS,Python)

    Toulouse 2013 - 2015

  • Texas Instruments - Expert Vérification (Specman)

    Villeneuve-Loubet 2012 - 2012 Vérification fonctionnelle de l'IP DMM (Dynamic Memory Module) pour le SOC OMAP6

  • Freescale - Expert Vérification (SV-OVM)

    Toulouse 2011 - 2011 Vérification d'un composant à signal mixte pour l'automobile

  • EASII-IC - Expert Vérification (Specman, System Verilog-UVM) / Responsable de Centre de Design

    2011 - 2013 Développement interne de VIP (I2C, SPI, ...)
    Support en vérification pour les projets internes
    Gestion du site de design de Toulouse

  • ST-Ericsson - Expert Vérification (Specman)

    2010 - 2010 Vérification fonctionnelle d'IP multimedia pour plateformes de téléphonie mobile

  • ST-Ericsson - Ingénieur Logiciel Couches Basses (C)

    2009 - 2010 Développement et vérification des couches basses logicielles pour des plateformes de téléphonie mobile 3G/4G.

  • ST Microelectronics - Expert Verification (Specman)

    2008 - 2009 Vérification top level d'une plateforme de téléphonie mobile LTE. Mise un place d'un nouveau processus de vérification d'intégration des sous-modules autour de l'interconnect AXI/STBUS.

  • SDV CONSEIL - Gérant

    2007 - 2010 Fournir des prestations de conception, vérification en micro-électroniques au entreprises du secteur (Texas Instruments, ST Microelectronics, ST Ericsson, FreeScale ...)

  • ST Microelectronics - Expert Vérification (Specman)

    2007 - 2008 Je suis responsable de la vérification fonctionnelle et formelle d'un module d'interfaçage entre un ou plusieurs écrans et la puce multimédia pour des téléphones mobiles de 3ème génération.
    Au sein d'une équipe multi-site et multilingues (3 continents) de 5 ingénieurs en vérification, je suis l'expert de la méthologie et du langage E de l'outil Specman (Cadence) ainsi que des techniques de "property checking" sous Rulebase (IBM).

  • Texas Instruments - Responsable Vérification (Specman)

    Villeneuve-Loubet 2005 - 2006 Verification of mixed signal power management chip family (3 products) for 3G/3.5G phone platforms using Specman/Modelsim/Nanosim/Cadence

    1st Phase : Power subchip verification
    - Define/Design verification environment (eVC methodology)
    - Define new verification flow for mixed signal simulations
    - Define testplan and write test cases
    - Run test cases, code coverage (VNavigator) for RTL simulations
    - Train and manage 1 analog designer (on-site) on Nanosim simulations and netlist analysis

    2nd Phase : Power subchip verification leader on 3 products
    - Define verification environment (eVC methodology) and testplan
    - Create critical test cases (random generation)
    - Train and manage 2 verification engineers (India) to write the environment and the test cases, run simulations and code coverage
    - Train and manage 2 analog designers (on-site and Morocco) on Nanosim simulations and netlist analysis
    - Report status of the 3 chips to the management on a weekly basis
    - Define design enhancement according to 1-year experience on 3 different power management chips for both digital and analog

    3rd Phase : Chip verification leader
    - Lead the verification of the last power management chip generation
    - Define verification project plan
    - Track status of the 5 subchips leaders (USB/AUDIO/POWER/BatteryIF/TOP). The whole team is 30 engineers on 3 continents.
    - Define architecture/design enhancements

    Verification fonctionnelle : Specman/Modelsim
    Verification mixed-signal : Nanosim

  • TranSwitch - Ingénieur Vérification (Specman)

    2003 - 2005 Structural and functional verification of several communication chips (4 to 8 millions gates) for metropolitan networks (Ethernet over Sonet) using Specman/Modelsim.
    - Define/Design verification environment
    - Define code coverage and functional coverage metrics.
    - Define testplan
    - Run testcases and code coverage

    Introduce assertion based verification to the company (PSL with Magellan and SafeLogic)

    Functinal Verification : Specman/Modelsim
    Formal Verification (static and dynamic) : langage PSL, SystemVerilog, Magellan, Modelsim

  • TranSwitch - Ingénieur Logiciel (C)

    2002 - 2003 Protocol stack design and verification in C for a DSLAM network processor
    - Functional specification writing (ATM, PPP, IP, MPLS, Ethernet)
    - Validation plan writing
    - Application and testbench coding in C
    - Integration on a Tensilica processor

    Market study on WLAN chips opportunity for TranSwitch (WiFi)

Formations

  • ENSEEIHT

    Toulouse 1999 - 2002 Ingénieur

    ( INP Handball / Club Invest' )

Réseau

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