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El Mehdi OUAKIF

LILLE

En résumé

Mes compétences :
JavaScript JAVA JAVA EE
SMPS LDO PLL CPN
LAYOUT ANALOG
VHDL FPGA MATLAB C
CADENCE MENTOR
DRC LVS DFM
Back end, Layout, Floor plan
LDO, SMPS, PLL, CPN, DAC/ADC
Virtuoso Cadence, Calibre, Mentor graphics, Unix
DRC, LVS, DFM, ESD

Entreprises

  • STMICROELECTRONICS - Apprenti ingénieur

    2010 - 2014 (48 mois) Poste occupé : Apprenti ingénieur Design Layout microélectronique
    Missions réalisés:

    * Réalisation Layout LDO, SMPS, Band gap, PLL, CPN ;
    * Validation des IPs niveau LVS, DRC, DFM sur l'environnement Cadence. ;
    * Réalisation sur les technologies CMOS H9A, 90nm, 65nm, 40nm ;
    * Maitrise de la technologie FDSOI 25nm. ;
    * Réalisation Layout niveau TOP Ainsi que l'orientation des entrées/sorties IO des IPs pour le
    premier circuit de test technologie CMOS 40nm.
    * Design d'un convoyeur de courant qui sera intégrer dans les futurs générations des
    microcontrôleurs STM32 technologie 40nm.
    * Test de caractérisation des circuits SMPS (Line et Load Régulation) ;
    * la rédaction de la documentation

  • STERICSSON -  Layout microélectronique

    GRENOBLE 2010 - 2010 Poste occupé : Stagiaire Technicien Supérieur Layout microélectronique
    Tâches réalisés :

    * Layout partie commande INT d'une charge de pompe négative. ;
    * Assemblage de l'IP parties INT
    * Assemblage EXT technologie CMOS 40 nm. ;
    * Réalisation Layout niveau TOP du circuit intégré IC.
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Formations

  • Ecole D'Ingenieur

    Paris 2010 - 2014 Diplôme d'ingénieur

    Electronique & Télécommunications
    Ecole d'ingénieur CNAM
    Conservatoire National des Arts et Métiers

  • Ecole Superieur De Technologie (Fès)

    Fès 2007 - 2009 Diplôme universitaire de Technologie

    DUT Génie électrique et informatique industrielle GEII

Réseau

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